dts: dra7-ipu-common-early-boot.dtsi: Add all the ipu early boot related nodes
Add all the ipu early boot related nodes Signed-off-by: Keerthy <j-keerthy@ti.com> Signed-off-by: Amjad Ouled-Ameur <aouledameur@baylibre.com>
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fc6b41fefb
commit
0bfc701e67
@ -520,6 +520,7 @@ ARM TI
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M: Tom Rini <trini@konsulko.com>
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M: Tom Rini <trini@konsulko.com>
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S: Maintained
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S: Maintained
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T: git https://source.denx.de/u-boot/custodians/u-boot-ti.git
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T: git https://source.denx.de/u-boot/custodians/u-boot-ti.git
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F: arch/arm/dts/dra7*
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F: arch/arm/mach-davinci/
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F: arch/arm/mach-davinci/
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F: arch/arm/mach-k3/
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F: arch/arm/mach-k3/
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F: arch/arm/mach-keystone/
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F: arch/arm/mach-keystone/
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113
arch/arm/dts/dra7-ipu-common-early-boot.dtsi
Normal file
113
arch/arm/dts/dra7-ipu-common-early-boot.dtsi
Normal file
@ -0,0 +1,113 @@
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// SPDX-License-Identifier: GPL-2.0+
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/*
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* Copyright (C) 2019 Texas Instruments Incorporated - http://www.ti.com/
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*/
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/ {
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chosen {
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firmware-loader = &fs_loader0;
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};
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fs_loader0: fs_loader@0 {
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u-boot,dm-pre-reloc;
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compatible = "u-boot,fs-loader";
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phandlepart = <&mmc1 1>;
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};
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reserved-memory {
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#address-cells = <2>;
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#size-cells = <2>;
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ranges;
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u-boot,dm-spl;
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ipu2_memory_region: ipu2-memory@95800000 {
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||||||
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compatible = "shared-dma-pool";
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reg = <0x0 0x95800000 0x0 0x3800000>;
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|
reusable;
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|
status = "okay";
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||||||
|
u-boot,dm-spl;
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|
};
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ipu1_memory_region: ipu1-memory@9d000000 {
|
||||||
|
compatible = "shared-dma-pool";
|
||||||
|
reg = <0x0 0x9d000000 0x0 0x2000000>;
|
||||||
|
reusable;
|
||||||
|
status = "okay";
|
||||||
|
u-boot,dm-spl;
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||||||
|
};
|
||||||
|
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|
ipu1_pgtbl: ipu1-pgtbl@95700000 {
|
||||||
|
reg = <0x0 0x95700000 0x0 0x40000>;
|
||||||
|
no-map;
|
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|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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|
ipu2_pgtbl: ipu2-pgtbl@95740000 {
|
||||||
|
reg = <0x0 0x95740000 0x0 0x40000>;
|
||||||
|
no-map;
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
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||||||
|
};
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|
};
|
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|
|
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|
&timer3 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
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|
&timer4 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
|
||||||
|
&timer7 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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|
&timer8 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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||||||
|
&timer9 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
|
||||||
|
&timer11 {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
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|
&mmu_ipu1 {
|
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|
u-boot,dm-spl;
|
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|
};
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|
&mmu_ipu2 {
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||||||
|
u-boot,dm-spl;
|
||||||
|
};
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|
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|
&ipu1 {
|
||||||
|
status = "okay";
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||||||
|
memory-region = <&ipu1_memory_region>;
|
||||||
|
pg-tbl = <&ipu1_pgtbl>;
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
|
||||||
|
&ipu2 {
|
||||||
|
status = "okay";
|
||||||
|
memory-region = <&ipu2_memory_region>;
|
||||||
|
pg-tbl = <&ipu2_pgtbl>;
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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|
&l4_wkup {
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||||||
|
u-boot,dm-spl;
|
||||||
|
};
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|
&prm {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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|
&ipu1_rst {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
|
||||||
|
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|
&ipu2_rst {
|
||||||
|
u-boot,dm-spl;
|
||||||
|
};
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