Merge branch 'pci/tegra'
- Add MCFG quirks for Tegra194 ECAM errata (Vidya Sagar) * pci/tegra: PCI: tegra: Add Tegra194 MCFG quirks for ECAM errata
This commit is contained in:
@@ -18,7 +18,6 @@ obj-$(CONFIG_PCIE_INTEL_GW) += pcie-intel-gw.o
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obj-$(CONFIG_PCIE_KIRIN) += pcie-kirin.o
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obj-$(CONFIG_PCIE_HISI_STB) += pcie-histb.o
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obj-$(CONFIG_PCI_MESON) += pci-meson.o
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obj-$(CONFIG_PCIE_TEGRA194) += pcie-tegra194.o
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obj-$(CONFIG_PCIE_UNIPHIER) += pcie-uniphier.o
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obj-$(CONFIG_PCIE_UNIPHIER_EP) += pcie-uniphier-ep.o
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@@ -39,5 +38,6 @@ ifdef CONFIG_ACPI
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ifdef CONFIG_PCI_QUIRKS
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obj-$(CONFIG_ARM64) += pcie-al.o
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obj-$(CONFIG_ARM64) += pcie-hisi.o
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obj-$(CONFIG_ARM64) += pcie-tegra194.o
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endif
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endif
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@@ -22,6 +22,8 @@
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#include <linux/of_irq.h>
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#include <linux/of_pci.h>
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#include <linux/pci.h>
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#include <linux/pci-acpi.h>
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#include <linux/pci-ecam.h>
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#include <linux/phy/phy.h>
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#include <linux/pinctrl/consumer.h>
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#include <linux/platform_device.h>
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@@ -311,6 +313,104 @@ struct tegra_pcie_dw_of_data {
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enum dw_pcie_device_mode mode;
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};
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#if defined(CONFIG_ACPI) && defined(CONFIG_PCI_QUIRKS)
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struct tegra194_pcie_ecam {
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void __iomem *config_base;
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void __iomem *iatu_base;
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void __iomem *dbi_base;
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};
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static int tegra194_acpi_init(struct pci_config_window *cfg)
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{
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struct device *dev = cfg->parent;
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struct tegra194_pcie_ecam *pcie_ecam;
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pcie_ecam = devm_kzalloc(dev, sizeof(*pcie_ecam), GFP_KERNEL);
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if (!pcie_ecam)
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return -ENOMEM;
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pcie_ecam->config_base = cfg->win;
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pcie_ecam->iatu_base = cfg->win + SZ_256K;
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pcie_ecam->dbi_base = cfg->win + SZ_512K;
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cfg->priv = pcie_ecam;
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return 0;
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}
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static void atu_reg_write(struct tegra194_pcie_ecam *pcie_ecam, int index,
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u32 val, u32 reg)
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{
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u32 offset = PCIE_GET_ATU_OUTB_UNR_REG_OFFSET(index);
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writel(val, pcie_ecam->iatu_base + offset + reg);
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}
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static void program_outbound_atu(struct tegra194_pcie_ecam *pcie_ecam,
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int index, int type, u64 cpu_addr,
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||||
u64 pci_addr, u64 size)
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{
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||||
atu_reg_write(pcie_ecam, index, lower_32_bits(cpu_addr),
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||||
PCIE_ATU_LOWER_BASE);
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||||
atu_reg_write(pcie_ecam, index, upper_32_bits(cpu_addr),
|
||||
PCIE_ATU_UPPER_BASE);
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||||
atu_reg_write(pcie_ecam, index, lower_32_bits(pci_addr),
|
||||
PCIE_ATU_LOWER_TARGET);
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||||
atu_reg_write(pcie_ecam, index, lower_32_bits(cpu_addr + size - 1),
|
||||
PCIE_ATU_LIMIT);
|
||||
atu_reg_write(pcie_ecam, index, upper_32_bits(pci_addr),
|
||||
PCIE_ATU_UPPER_TARGET);
|
||||
atu_reg_write(pcie_ecam, index, type, PCIE_ATU_CR1);
|
||||
atu_reg_write(pcie_ecam, index, PCIE_ATU_ENABLE, PCIE_ATU_CR2);
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||||
}
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static void __iomem *tegra194_map_bus(struct pci_bus *bus,
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||||
unsigned int devfn, int where)
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{
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struct pci_config_window *cfg = bus->sysdata;
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||||
struct tegra194_pcie_ecam *pcie_ecam = cfg->priv;
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||||
u32 busdev;
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||||
int type;
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||||
if (bus->number < cfg->busr.start || bus->number > cfg->busr.end)
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return NULL;
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||||
if (bus->number == cfg->busr.start) {
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||||
if (PCI_SLOT(devfn) == 0)
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return pcie_ecam->dbi_base + where;
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else
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return NULL;
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}
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busdev = PCIE_ATU_BUS(bus->number) | PCIE_ATU_DEV(PCI_SLOT(devfn)) |
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PCIE_ATU_FUNC(PCI_FUNC(devfn));
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||||
if (bus->parent->number == cfg->busr.start) {
|
||||
if (PCI_SLOT(devfn) == 0)
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||||
type = PCIE_ATU_TYPE_CFG0;
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||||
else
|
||||
return NULL;
|
||||
} else {
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||||
type = PCIE_ATU_TYPE_CFG1;
|
||||
}
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||||
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||||
program_outbound_atu(pcie_ecam, 0, type, cfg->res.start, busdev,
|
||||
SZ_256K);
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||||
|
||||
return pcie_ecam->config_base + where;
|
||||
}
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||||
const struct pci_ecam_ops tegra194_pcie_ops = {
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.init = tegra194_acpi_init,
|
||||
.pci_ops = {
|
||||
.map_bus = tegra194_map_bus,
|
||||
.read = pci_generic_config_read,
|
||||
.write = pci_generic_config_write,
|
||||
}
|
||||
};
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||||
#endif /* defined(CONFIG_ACPI) && defined(CONFIG_PCI_QUIRKS) */
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#ifdef CONFIG_PCIE_TEGRA194
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static inline struct tegra_pcie_dw *to_tegra_pcie(struct dw_pcie *pci)
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||||
{
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||||
return container_of(pci, struct tegra_pcie_dw, pci);
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||||
@@ -2311,3 +2411,5 @@ MODULE_DEVICE_TABLE(of, tegra_pcie_dw_of_match);
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MODULE_AUTHOR("Vidya Sagar <vidyas@nvidia.com>");
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||||
MODULE_DESCRIPTION("NVIDIA PCIe host controller driver");
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||||
MODULE_LICENSE("GPL v2");
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#endif /* CONFIG_PCIE_TEGRA194 */
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