ath9k_hw: add GPIO setup code for AR9271
Assign the proper number of GPIO pins for AR9271. Signed-off-by: Sujith <Sujith.Manoharan@atheros.com> Signed-off-by: Vasanthakumar Thiagarajan <vasanth@atheros.com> Signed-off-by: Luis R. Rodriguez <lrodriguez@atheros.com> Signed-off-by: John W. Linville <linville@tuxdriver.com>
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5b5fa3558d
@ -3229,7 +3229,9 @@ int ath9k_hw_fill_cap_info(struct ath_hw *ah)
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else
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pCap->tx_triglevel_max = MAX_TX_FIFO_THRESHOLD;
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if (AR_SREV_9285_10_OR_LATER(ah))
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||||
if (AR_SREV_9271(ah))
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pCap->num_gpio_pins = AR9271_NUM_GPIO;
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else if (AR_SREV_9285_10_OR_LATER(ah))
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||||
pCap->num_gpio_pins = AR9285_NUM_GPIO;
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||||
else if (AR_SREV_9280_10_OR_LATER(ah))
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||||
pCap->num_gpio_pins = AR928X_NUM_GPIO;
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@ -3465,7 +3467,9 @@ u32 ath9k_hw_gpio_get(struct ath_hw *ah, u32 gpio)
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if (gpio >= ah->caps.num_gpio_pins)
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return 0xffffffff;
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if (AR_SREV_9287_10_OR_LATER(ah))
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if (AR_SREV_9271(ah))
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return MS_REG_READ(AR9271, gpio) != 0;
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||||
else if (AR_SREV_9287_10_OR_LATER(ah))
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return MS_REG_READ(AR9287, gpio) != 0;
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||||
else if (AR_SREV_9285_10_OR_LATER(ah))
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||||
return MS_REG_READ(AR9285, gpio) != 0;
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@ -3494,6 +3498,9 @@ EXPORT_SYMBOL(ath9k_hw_cfg_output);
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void ath9k_hw_set_gpio(struct ath_hw *ah, u32 gpio, u32 val)
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{
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if (AR_SREV_9271(ah))
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val = ~val;
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REG_RMW(ah, AR_GPIO_IN_OUT, ((val & 1) << gpio),
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AR_GPIO_BIT(gpio));
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}
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@ -940,6 +940,7 @@ enum {
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#define AR928X_NUM_GPIO 10
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#define AR9285_NUM_GPIO 12
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#define AR9287_NUM_GPIO 11
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#define AR9271_NUM_GPIO 16
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#define AR_GPIO_IN_OUT 0x4048
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#define AR_GPIO_IN_VAL 0x0FFFC000
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@ -950,6 +951,8 @@ enum {
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#define AR9285_GPIO_IN_VAL_S 12
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#define AR9287_GPIO_IN_VAL 0x003FF800
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#define AR9287_GPIO_IN_VAL_S 11
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#define AR9271_GPIO_IN_VAL 0xFFFF0000
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#define AR9271_GPIO_IN_VAL_S 16
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#define AR_GPIO_OE_OUT 0x404c
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#define AR_GPIO_OE_OUT_DRV 0x3
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