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synced 2024-11-23 12:42:02 +00:00
Revert the ARM/dts changes for Renesas RZ/N1
Based on a request from Geert: Revert "ARM: dts: r9a06g032-rzn1d400-db: add switch description" This reverts commit9aab31d66e. Revert "ARM: dts: r9a06g032: describe switch" This reverts commitcf9695d8a7. Revert "ARM: dts: r9a06g032: describe GMAC2" This reverts commit3f5261f1c2. Revert "ARM: dts: r9a06g032: describe MII converter" This reverts commit066c3bd358. to let these changes flow thru the platform and SoC trees. Link: https://lore.kernel.org/r/CAMuHMdUvSLFU56gsp1a9isOiP9otdCJ2-BqhbrffcoHuA6JNig@mail.gmail.com/ Link: https://lore.kernel.org/r/20220627173900.3136386-1-kuba@kernel.org Signed-off-by: Jakub Kicinski <kuba@kernel.org>
This commit is contained in:
Jakub Kicinski
parent
957b96e35b
commit
eba3a9816a
@ -8,8 +8,6 @@
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/dts-v1/;
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/dts-v1/;
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#include <dt-bindings/pinctrl/rzn1-pinctrl.h>
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#include <dt-bindings/net/pcs-rzn1-miic.h>
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#include "r9a06g032.dtsi"
|
#include "r9a06g032.dtsi"
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/ {
|
/ {
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@ -33,118 +31,3 @@
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timeout-sec = <60>;
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timeout-sec = <60>;
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status = "okay";
|
status = "okay";
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};
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};
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||||||
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||||||
&gmac2 {
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status = "okay";
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phy-mode = "gmii";
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fixed-link {
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||||||
speed = <1000>;
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full-duplex;
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};
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};
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&switch {
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status = "okay";
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#address-cells = <1>;
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#size-cells = <0>;
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||||||
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pinctrl-names = "default";
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||||||
pinctrl-0 = <&pins_mdio1>, <&pins_eth3>, <&pins_eth4>;
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dsa,member = <0 0>;
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mdio {
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clock-frequency = <2500000>;
|
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||||||
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||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
|
|
||||||
|
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||||||
switch0phy4: ethernet-phy@4 {
|
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||||||
reg = <4>;
|
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||||||
micrel,led-mode = <1>;
|
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||||||
};
|
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||||||
|
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||||||
switch0phy5: ethernet-phy@5 {
|
|
||||||
reg = <5>;
|
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||||||
micrel,led-mode = <1>;
|
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||||||
};
|
|
||||||
};
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||||||
};
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||||||
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&switch_port0 {
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label = "lan0";
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||||||
phy-mode = "mii";
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||||||
phy-handle = <&switch0phy5>;
|
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||||||
status = "okay";
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||||||
};
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||||||
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||||||
&switch_port1 {
|
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||||||
label = "lan1";
|
|
||||||
phy-mode = "mii";
|
|
||||||
phy-handle = <&switch0phy4>;
|
|
||||||
status = "okay";
|
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||||||
};
|
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||||||
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&switch_port4 {
|
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||||||
status = "okay";
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||||||
};
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||||||
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ð_miic {
|
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||||||
status = "okay";
|
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||||||
renesas,miic-switch-portin = <MIIC_GMAC2_PORT>;
|
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||||||
};
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||||||
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||||||
&mii_conv4 {
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||||||
renesas,miic-input = <MIIC_SWITCH_PORTB>;
|
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||||||
status = "okay";
|
|
||||||
};
|
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||||||
|
|
||||||
&mii_conv5 {
|
|
||||||
renesas,miic-input = <MIIC_SWITCH_PORTA>;
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
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||||||
&pinctrl{
|
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||||||
pins_mdio1: pins_mdio1 {
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pinmux = <
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||||||
RZN1_PINMUX(152, RZN1_FUNC_MDIO1_SWITCH)
|
|
||||||
RZN1_PINMUX(153, RZN1_FUNC_MDIO1_SWITCH)
|
|
||||||
>;
|
|
||||||
};
|
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||||||
pins_eth3: pins_eth3 {
|
|
||||||
pinmux = <
|
|
||||||
RZN1_PINMUX(36, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(37, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(38, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(39, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(40, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(41, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(42, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(43, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(44, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(45, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(46, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(47, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
>;
|
|
||||||
drive-strength = <6>;
|
|
||||||
bias-disable;
|
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||||||
};
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||||||
pins_eth4: pins_eth4 {
|
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||||||
pinmux = <
|
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||||||
RZN1_PINMUX(48, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(49, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(50, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(51, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(52, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(53, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(54, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(55, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(56, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(57, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(58, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
RZN1_PINMUX(59, RZN1_FUNC_CLK_ETH_MII_RGMII_RMII)
|
|
||||||
>;
|
|
||||||
drive-strength = <6>;
|
|
||||||
bias-disable;
|
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||||||
};
|
|
||||||
};
|
|
||||||
|
|||||||
@ -304,114 +304,6 @@
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|||||||
data-width = <8>;
|
data-width = <8>;
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||||||
};
|
};
|
||||||
|
|
||||||
gmac2: ethernet@44002000 {
|
|
||||||
compatible = "renesas,r9a06g032-gmac", "renesas,rzn1-gmac", "snps,dwmac";
|
|
||||||
reg = <0x44002000 0x2000>;
|
|
||||||
interrupt-parent = <&gic>;
|
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||||||
interrupts = <GIC_SPI 37 IRQ_TYPE_LEVEL_HIGH>,
|
|
||||||
<GIC_SPI 39 IRQ_TYPE_LEVEL_HIGH>,
|
|
||||||
<GIC_SPI 38 IRQ_TYPE_LEVEL_HIGH>;
|
|
||||||
interrupt-names = "macirq", "eth_wake_irq", "eth_lpi";
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||||||
clocks = <&sysctrl R9A06G032_HCLK_GMAC1>;
|
|
||||||
clock-names = "stmmaceth";
|
|
||||||
power-domains = <&sysctrl>;
|
|
||||||
snps,multicast-filter-bins = <256>;
|
|
||||||
snps,perfect-filter-entries = <128>;
|
|
||||||
tx-fifo-depth = <2048>;
|
|
||||||
rx-fifo-depth = <4096>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
eth_miic: eth-miic@44030000 {
|
|
||||||
compatible = "renesas,r9a06g032-miic", "renesas,rzn1-miic";
|
|
||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
|
|
||||||
reg = <0x44030000 0x10000>;
|
|
||||||
clocks = <&sysctrl R9A06G032_CLK_MII_REF>,
|
|
||||||
<&sysctrl R9A06G032_CLK_RGMII_REF>,
|
|
||||||
<&sysctrl R9A06G032_CLK_RMII_REF>,
|
|
||||||
<&sysctrl R9A06G032_HCLK_SWITCH_RG>;
|
|
||||||
clock-names = "mii_ref", "rgmii_ref", "rmii_ref", "hclk";
|
|
||||||
power-domains = <&sysctrl>;
|
|
||||||
status = "disabled";
|
|
||||||
|
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||||||
mii_conv1: mii-conv@1 {
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|
||||||
reg = <1>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
mii_conv2: mii-conv@2 {
|
|
||||||
reg = <2>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
mii_conv3: mii-conv@3 {
|
|
||||||
reg = <3>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
mii_conv4: mii-conv@4 {
|
|
||||||
reg = <4>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
mii_conv5: mii-conv@5 {
|
|
||||||
reg = <5>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
switch: switch@44050000 {
|
|
||||||
compatible = "renesas,r9a06g032-a5psw", "renesas,rzn1-a5psw";
|
|
||||||
reg = <0x44050000 0x10000>;
|
|
||||||
clocks = <&sysctrl R9A06G032_HCLK_SWITCH>,
|
|
||||||
<&sysctrl R9A06G032_CLK_SWITCH>;
|
|
||||||
clock-names = "hclk", "clk";
|
|
||||||
power-domains = <&sysctrl>;
|
|
||||||
status = "disabled";
|
|
||||||
|
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||||||
ethernet-ports {
|
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||||||
#address-cells = <1>;
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|
||||||
#size-cells = <0>;
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||||||
|
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||||||
switch_port0: port@0 {
|
|
||||||
reg = <0>;
|
|
||||||
pcs-handle = <&mii_conv5>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
switch_port1: port@1 {
|
|
||||||
reg = <1>;
|
|
||||||
pcs-handle = <&mii_conv4>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
switch_port2: port@2 {
|
|
||||||
reg = <2>;
|
|
||||||
pcs-handle = <&mii_conv3>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
switch_port3: port@3 {
|
|
||||||
reg = <3>;
|
|
||||||
pcs-handle = <&mii_conv2>;
|
|
||||||
status = "disabled";
|
|
||||||
};
|
|
||||||
|
|
||||||
switch_port4: port@4 {
|
|
||||||
reg = <4>;
|
|
||||||
ethernet = <&gmac2>;
|
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||||||
label = "cpu";
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||||||
phy-mode = "internal";
|
|
||||||
status = "disabled";
|
|
||||||
fixed-link {
|
|
||||||
speed = <1000>;
|
|
||||||
full-duplex;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
gic: interrupt-controller@44101000 {
|
gic: interrupt-controller@44101000 {
|
||||||
compatible = "arm,gic-400", "arm,cortex-a7-gic";
|
compatible = "arm,gic-400", "arm,cortex-a7-gic";
|
||||||
interrupt-controller;
|
interrupt-controller;
|
||||||
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